AD9833_中文资料

AD9833

特性：

频率、相位数字可编程

能耗：20mW/3V

输出频率范围：0～12.5MHz

输出波类型：正弦波、三角波、方波。

工作电压范围：2.3～5.5V。

不需外部组件。

3线SPI接口。

工作温度范围：－40～＋105℃

低功耗选择。

10管脚MSOP封装

应用：

频率激发/波形产生。

液体、气流测量。

传感应用——逼近、运动、缺陷探测。

线性损失、线性衰减。

测试设备、医疗设备

扫描、时钟产生器

概述：

AD9833是一款低功耗、可编程波形发生器，可以产生正弦波、三角波、方波。

输出频率和相位可软件编程，很容易调整，而不需要外部组件。频率寄存器是28位的，如果是25M的时钟源，经过编程可以得到0.1Hz的时钟；同样如果是1M的时钟源，可以得到0.004Hz的时钟。

AD9833通过3线串口进行写操作。串口工作时钟频率高达40M，并与DSP和微处理器标准兼容。其工作电压在2.3V～5.5V之间。

AD9833还具有休眠功能，可使没被使用的部分休眠，减少该部分的电流损耗，例如，若利用AD9833输出作为时钟源，就可以让DAC休眠，以减小功耗，该电路采用10引脚MSOP型表面贴片封装，体积很小。

图一规范测试电路

原理框图：

AD9833规范

图二控制时钟时间特性：

图三串行时序

最大绝对额定值：

VDD to AGND . . . . . . . . . . . . . . . . . . . .–0.3 V to +6 V

VDD to DGND . . . . . . . . . . . . . . . . . . . .–0.3 V to +6 V

AGND to DGND . . . . . . . . . . . . . . . . . . . –0.3 V to +0.3 V

CAP/2.5 V . . . . . . . . . . . . . . . . . . . . . . . . . .2.75 V

Digital I/O Voltage to DGND . . . . . . . . . .–0.3 V to VDD + 0.3 V

Analog I/O Voltage to AGND . . . . . . . . . . .–0.3 V to VDD + 0.3 V Operating Temperature Range

Industrial (B Version) . . . . . . . . . . . . . . . –40℃to +105℃

Storage Temperature Range . . . . . . . . . . . . .–65℃ to +150℃

Maximum Junction Temperature . . . . . . . . . . . . . . . . . 150℃

MSOP Package

θJA Thermal Impedance . . . . . . . . . . . . . . . . . . . . .206℃/W

θJC Thermal Impedance . . . . . . . . . . . . . . . . . . . . . 44℃/W

Lead Temperature, Soldering (10 sec) . . . . . . . . . . . . . . 300℃

IR Reflow, Peak Temperature . . . . . . . . . . . . . . . . . . . 220℃

选型参考：

注意：

(静电释放) 敏感设备。人体和测试设备很容易产生高达4000V的静电，这些静电 ESD

也会在不经意间自己释放掉。虽然AD9833 以ESD保护电路为其特色,高压静电释放还是可能会给设备带来永久性的伤害。所以, 应当采取适当的ESD防备措施避免功能性能退化或损失。

管脚定义：

管脚功能描述：

管脚号名称功能电源

2 3

4 9 VDD

CAP/2.5V

DGND

AGND

模拟和数字接口部分的电源供给。板上2.5V标准电压也是由VDD产

生的。VDD可以是2.3V和5.5V之间的电压值。VDD和AGND之间

应该连接一个0.1uF和10uF的非耦合电容。

数字电路工作电压是2.5V。这个2.5V电压是从VDD通过板上稳压器

产生的。VDD小于2.7V时,稳压器要求CAP/2.5V和DGND之间连接

一个100uF的非耦合电容；如果VDD不大于

2.7V时，CAP/2.5V和DGND直接相连。

数字地

模拟地

模拟信号

1 10 COMP

VOUT

DAC偏差管脚，用以退耦DAC偏差电压。

电压输出，可输出模拟或者数字电压。自带200ohm的电阻，不需要外

部上拉电阻。

数字接口与控制

5

6 7 8 MCLK

SDATA

SCLK

FSYNC

数字时钟输入。DDS输出频率是MCLK的二进制分数形式。输出频率

的准确性和相位噪声由这个时钟确定。

串行数据输入，采用16位串行数据字格式。

串行时钟输入，数据在时钟下降沿输入AD9833。

低有效控制输入，数据输入的帧同步信号。当FSYNC被拉低时，内部

逻辑就表示一个新的数据被载入。

AD9833 典型的性能特性：

AD9833的一些术语

积分非线性：

这是指任意码与通过传输函数终点的直线的最大偏差。传输函数的零点是零刻度，比第一个转化码小0.5LSB的点，满刻度，比最后一个转化码高0.5LSB的点。误差以多少LSB 的形式表示。

差分非线性度：

这是在DAC上相邻两个代码变化1LSB在测量和理想状况下的差异。一个指定的最大范围是±1LSB的差分非线性度可以保证单调性。

输出标准：

输出标准指的是在DAC输出产生的满足规范的最大电压值。如果有比指定标准高的电压产生，AD9833可能就不符合记录表中的标准。

无寄生动态范围（SFDR）：

和感兴趣的频率一起，基频波的谐波频率以及这些频率的像都会出现在DDS电路的输出上。无寄生动态范围（SFDR）指的是出现在感兴趣波段的激励或谐波。宽带SFDR会给出在0到奈奎斯特带宽内与基带频率大小有关的最大的谐波或激励的大小。窄带SFDR会给出在基带频率±200kHz带宽内最大的谐波或激励的衰减。

总谐波失真：

总谐波失真（THD）是谐波绝对和与基波绝对值的比值。对于AD9833，THD定义为：

这里，V1是基波绝对幅度，V2,V3,V4,V5,V6分别是2到6次谐波的绝对幅度。

信噪比（SNR）

SNR是在奈奎斯特频率下测量输出信号的绝对值和其他所有频谱成分的绝对和的比值。SNR值以分贝形式表示。

时钟馈入

MCLK输入会有到模拟输出的馈入。时钟馈入指的是与AD9833输出频谱中基带频率相关的MCLK信号的数量。

操作原理

由于波形常常是用幅度形式（a(t) = sin(wt)）加以考虑。这些都是非线性的，也很难产生，除非用分段构造方法。另外，角型信息实际上是线性的。也就是说，相位角每一个单位时间会改变一个固定的角度。角速度依赖于信号的频率（ω= 2π_f）。

图 四

正弦波的相位是线性的，只要给出参考时间间隔，这个间隔的相位变化就能确定。

Δ Phase = ωΔt

ω的计算：

ω =ΔPhase /Δt =2πf

计算f ，并用参考实在频率代替参考周期( 1/f MCLK = Δt )

f =ΔPhase ∞f MCLK / 2π

AD9833就是基于这个简单的等式构造输出。一块简单的DDS芯片加上三个主要的子电路（数控相位调制振荡器、SIN ROM 、数模转换器）就可以实现这个简单的等式。每一个子电路都会在下面提到。 电路结构

AD9833是一个完全集成的DDS电路，需要一个参考时钟、一个低精度电阻和去耦电容去产生高达12.5M的正弦波。除了产生这种射频信号，这款芯片完全能广泛适用于各种简单和复杂的调制方案。这些调制方案在数字领域得到了广泛应用，运用DSP技术能够使复杂的调制算法简化，而且很精确。 AD9833的内部电路由以下几部分组成：一个数控振荡器（NCO），频率和相位调制器，SIN ROM，一个数模转换器和一个调节器。 数控相位调制振荡器 这包括两个频率选择寄存器，一个相位累加器，两个相位偏移寄存器和一个相位加法器。 NCO 的主要组成部分是一个28位的相位累加器。连续时间信号的相位范围是：0～2π。超过这个范围时，正弦函数会周期性地重复。数字实现也是一样。累加器把相位值刻度多位数字字。AD9833中的相位累加器是以28位的形式进行操作的，所以在AD9833中，2π= 。同样, ΔPhase 范围也刻度成以下范围：0 < ΔPhase < －1。这样前面的等式就变成：

282282f =ΔPhase ?f MCLK / 0 < ΔPhase < －1

28228

2 相位累加器的输入由FREQ0或者FREQ1来选择，受FSELECT 控制。NCO本身可以产生连续的相位信号，因此在频率变化的时候需要防止输出的不连续。 在NCO后，用12位相位寄存器可以把相位偏移加入相位调制。其中一个相位寄存器的内容被加到NCO最重要的位上。AD9833由两个相位寄存器，它们的分辩率是：2π/4096 SIN ROM 为了让NCO的输出有用，必须把相位信息转化成正弦值。由于相位信息直接对应幅度值，SIN ROM把数字相位信息当作地址，通过查表把相位信息转化成幅度信息。虽然NCO包含的是28位的相位累加器，但NCO的输出却是截断了的12位。使用相位累加器的全精度是不现实的，也是不必要的，因为这需要查找表的所有个条目。只需要足够的相位精度，以使截断产生的误差小于10位DAC的精度，这就要求SIN ROM的相位精度要比10位DAC多两位。SIN ROM 通过控制寄存器的MODE（D1）位使能，表11中有更详尽的表述。 282数模转换器（DAC） AD9833包括一个高内阻电流源10位DAC。DAC从SIN ROM中获得数字字，再把他们转化成对应的模拟电压。 DAC被定义位单端模式。由于AD9833在板上的电阻有200 Ω，所以就不需要额外的电阻。DAC输出的一般是峰峰值为0.6V的电压。 调节器

VDD提供AD9833模拟部分和数字部分需要的电源，一般为：2.3V～5.5V. AD9833内部的数字部分工作在2.5V。一个板上调节器把VDD上的电压步减到2.5V。当AD9833管脚VDD上的电压小于等于2.7V时，CAP/2.5V 和VDD 两个管脚应该连起来，这样板上调节器就被旁路了。

功能描述

串行接口

AD9833有一个标准3线串行接口，与SPI、QSPI、MICROWIRE和DSP接口标准兼容。

在串行时钟输入SCLK的控制下，数据以16位字的形式写入AD9833。操作的时序如图三所示。

FSYNC输入是电平触发，可以作为帧同步和使能信号。数据只有在FSYNC为低的时候才能向里传输。要开始一个串行数据传输，FSYNC必须置低，可以看到FSYNC下降沿和SCLK下降沿之间有一个时间间隔（t7）。FSYNC置低以后，串行数据在16个SCLK下降沿被移位进输入移位寄存器。在第16个SCLK下降沿后FSYNC才能变高，可以看到SCLK 下降沿和FSYNC上升沿之间有一个时间间隔（t8）。同样，FSYNC可以在多组16个SCLK 脉冲期间保持低电平，等到数据传输完毕后再变高。这样，FSYNC保持低电平时可以传输连续的16位字流，FSYNC只有在最后一个字的第16个SCLK下降沿变高。

在写操作过程中，SCLK可以是连续的、一直高或者一直低，但是FSYNC变低时，它一定要是高。

AD9833上电

图七中的流程显示了AD9833的操作例程。AD9833上电时，组件需要重启。这会把一些内部寄存器重设为0，并给出一个模拟中值输出。为了防止AD9833初始化时产生虚假的DAC输出，RESET必须置1，直到各组件都准备好可以产生一个输出为止。RESET不会重新设置相位、频率和控制寄存器。这些寄存器中都会包含有效数据，所以应该让用户设置为某个值。要开始产生输出，RESET必须置0。在RESET置0八个MCLK周期后，数据会出现在DAC输出。

延时

AD9833中，有每一个异步写操作有关的就是延时。如果某个频率/相位寄存器要装载一个新字，模拟输出将会有七到八个MCLK周期的延时。（之所以会有一个周期的不确定，因为这和数据装载进目标寄存器时MCLK上升沿的位置有关。）

控制寄存器

AD9833包含一个16位的控制寄存器，通过设置控制寄存器可以使AD9833按照用户的需要工作在某种状态。除了MODE，其他所有控制位都是在MCLK的负时钟沿被采样。表2描述了控制寄存器的各个位。AD9833的不同功能和各种输出选项在表2的段落有详尽的描述。要通知AD9833控制寄存器的内容需要改变，就要把D15和D14置为0（如表1）。

表1 控制寄存器

图五控制位功能

表2 控制寄存器的位描述位名称功能

D13 D12

D11 D10 D9 D8

D7 D6 D5

B28

HLB

FSELECT

PSELECT

Reserved

RESET

SLEEP1

SLEEP12

OPBITEN

要把一个字装进频率寄存器需要两次写操作，B28＝1才允许这样的操作。第一次写包含频率字低14位，第二次包含频率字高14位。每个16位字的开始两位指定了

要写入的频率寄存器，而且在连续两次写操作中应该使一样的。具体表述参见表4。

对频率寄存器的写操作发生在两个字都被装载之后，所以寄存器不会保持立即数。

表5是一个完整的28位写操作的例子。

当B28＝0，28位频率寄存器可以当作14位的寄存器来操作。一个包含高14位，另一个包含低14位。这就意味着高14位和低14位都可以独立地改变。控制寄存器

中的HLB(D12)位指定了哪一个14位正在被改变。

该控制位允许用户能够忽略另外14位连续地装载频率寄存器的MSB或者LSB。

这在不需要用完整的28位的时候很有用。HLB要与D13(B28)一起使用。该控制位

表明正在装载的14位数据是指定频率寄存器的高14位还是低14位。要独立地改变

一个频率字的MSB或者LSB，必须把D13(B28)置0。D13(B28)置1时，HLB被忽

略。

HLB＝1,允许一个对指定频率寄存器的高14位的写操作。

HLB＝0,允许一个对指定频率寄存器的低14位的写操作。

该位指定是FREQ0还是FREQ1用于相位累加器。

该位指定是PHASE0还是PHASE1数据加入相位累加器的输出。

该位应置为0。

为1时，重新设置内部寄存器为0，提供一个中值模拟输出。

为0时，禁止RESET。

SLEEP1=1时，内部MCLK时钟被禁，DAC的输出保持当前值，NCO也不再计数。

SLEEP1=0时，MCLK被使能，具体描述见表10。

为1时，切断片上DAC电源。这对于用AD9833输出DAC数据的MSB很有帮助。

为0时，说明DAC有效。表10中有更详尽的表述。

该位的功能和D1(MODE)有关。控制VOUT的输出。表11有更详尽的表述。

为1时，连接到VOUT的不再是DAC的输出，而是DAC数据的MSB或MSB/2

D4 D3 D2 D1 D0

Reserved DIV2 Reserved MODE Reserved

（由DIV2来决定），这适合做一个粗略时钟源。

为0时，DAC 连接到VOUT 。由MODE 来决定输出时正弦波还是斜波。 该位应置为0。

和D5(OPBITEN)一起使用。表11有说明。 为1时，DAC 数据的MSB 直接连到VOUT 。 为0时，DAC 数据的MSB/2连到VOUT 。 该位应置为0。

该位和OPBITEN （D5）一起使用，其功能是在片上DAC 连到VOUT 时控制VOUT 的输出。OPBITEN ＝1时，该位应该置0。表11有详尽的表述。 MODE=1，SIN ROM 被旁路，DAC 输出三角波。

MODE=0，SIN ROM 的用途就是把频率和相位寄存器中的相位信息转换成在输出端产生正弦波的幅度信息。 该位应置为0。

频率和相位寄存器：

AD9833有两个频率寄存器和两个相位寄存器，如表3所述。

表

3 频率/相位寄存器

寄存器 大小 描述

FREQ0

FREQ1

PHASE0

PHASE1

28Bits 28Bits 12Bits 12Bits

频率寄存器0。当FSELECT 位置为0，该寄存器规定输出频率为MCLK 频率的一个分值比。

频率寄存器1。当FSELECT 位置为1，该寄存器规定输出频率为MCLK 频率的一个分值比。

相移寄存器0。当PSELECT 位置为0，该寄存器的内容会加入相位累加器的输出。

相移寄存器1。当PSELECT 位置为1，该寄存器的内容会加入相位累加器的输出。

AD9833的模拟输出：

f MCLK /? FREQREG

28

2

FREQREG 是装载到指定频率寄存器的值。信号的相移：

2 π/4096?PHASEREG

PHASEREG 是指定相位寄存器中的值。为防止意料不到的输出异常，指定输出频率和参考时钟频率的关系应该给予考虑。 图九中的数据流程显示了写AD9833频率寄存器和相位寄存器的例程。 写频率寄存器 写频率寄存器时，位D15和D14给出频率寄存器的地址。

表4 频率寄存器的位

如果用户想改变一个频率寄存器的所有内容，要向同一地址连续写两次，这是因为频率

寄存1器是28位的。第一次写改变低14位，第二次写改变高14位。为了使用这种操作模式，控制位B28(D13)应该置1。表5中是一个28位写的例子。

表5 向FREQ0寄存器写00FC00

在某些应用中，用户不需要改变频率寄存器中的所有28位。要大的调整，只要改变高14位；要细微的调整，只要改变低14位就行。把控制位B28(D13)置为0，28位的频率寄存器就可以当成两个14位的寄存器来操作，一个包含高14位，另一个包含低14位。这就意味着高14位和低14位都可以独立地改变。控制寄存器中的HLB(D12)位指定了哪一个14位正在被改变。表6和表7是两个例子。

表6 向FREQ的低14位写3FFF

表7向FREQ的高14位写00FF

写相位寄存器

写相位寄存器时，位D15和D14都置1。D13指定那个相位寄存器要写入。

表8 相位寄存器的位

重启功能：

重启功能会重新设置一些适当的内部寄存器为0，提供一个中值模拟输出。重启不会重新设置相位、频率和控制寄存器。AD9833上电时，这部分就会被重新设置。要重启AD9833，把RESET置为1就行了。如果要不重新设置这部分，把RESET置为0。RESET置为0后，

一个信号将出现在DAC 以输出8个MCLK 时钟周期。

表9 应用于重启

重启位 结果

0 1

对重启不做反应 内部寄存器重启

休眠功能： 可以切断AD9833没有使用部分的电源以减少功耗，这可以通过休眠功能来实现。能被切断电源的有内部时钟和DAC 。休眠功能需要的位如表10所示。

表10 应用于休眠功能

SLEEP1 Bit

SLEEP12 Bit

结果 0 0 1 1

0 1 0 1

无电源切断 DAC 电源切断 内部时钟禁止

DAC 电源切断 内部时钟也禁止

DAC 电源切断： 这个功能在AD9833用来只输出DAC 的MSB 的时候很有用。这个情况下，不需要DAC ，就可以切断它的电源以降低能耗。 内部时钟禁止： 当AD9833的内部时钟被禁止，DAC 的输出保持当前值，

NCO 也不再计数。当SLEEP1控制位有效时，新的频率、相位和控制字能写进去这部分。同步时钟依然有效，这就意味着用这些控制位可以修改一些选定的频率和相位寄存器。把SLEEP1设置为0就能激活MCLK 。当SLEEP1有效时，这些寄存器的任何变化都会在一个延时后反映在输出上。 VOUT Pin

AD9833提供多种类型的输出，比如DAC 数据的MSB 、正弦波输出、三角波输出，这些输出都外接到VOUT 管脚。控制寄存器中的OPBITEN(D5)和MODE(D1)位可以决定AD9833输出是哪一种类型。这在下面还会提及，表11也有说明。

表11 VOUT 的不同输出

DAC 数据的MSB ：

DAC 数据的MSB 可以从AD9833中输出。把OPBITEN(D5)控制位设置为1，DAC 数据的MSB 就可以从VOUT 管脚获得。这可以作为粗略时钟源。这个方波在输出还可以被二分。控制寄存器中的DIV2（D3）控制着这种输出的频率。 正弦波输出： SIN ROM 的用途是把频率和相位寄存器中的相位信息转换成在输出端产生正弦波的幅度信息。要从VOUT 管脚获得正弦波输出，就要把MDOE(D1)位和OPBITEN(D5)位置为0。 三角波输出： SIN ROM 可以被旁路，从NCO 来的截平的数字输出就可以送到DAC 。这样输出就不再是正弦波，DAC 会产生一个10-bit 线性三角函数。要从VOUT 管脚获得三角波输出，需

要把MODE(D1)位置为1。要使用这个管脚，就要把SLEEP12都置为0。

图六三角波输出

应用：

由于可以获得多种输出，AD9833 可能被配置以适应各种各样的应用，模块化应用就是其中之一，它可能被用来执行简单的模块化，比如FSK。更加复杂的模块化方案，比如GMSK 和QPSK，也可以用AD9833实现。在FSK应用中，AD9833的两个频率寄存器分别装载不同的值。一个频率代表空间频率，另一个代表标记频率。用户可以通过设置AD9833控制寄存器中的FSELECT位使载波频率在这两个值之间改变。

AD9833有两个相位寄存器，这就能实现PSK。有了相移键控，就可以使载波频率相移，相位改变数值与输入到调节器的位流相关。

AD9833也适合信号产生应用。由于DAC数据的MSB可以从VOUT管脚得到，所以

AD9833可以用来产生方波。由于其低功耗，它同样适合在一些应用中做本地振荡器。

接地和布局：

设计安置有AD9833的印制电路板时，应该注意让模拟部分和数字部分分别限制在电路板的不同区域。这样可以使对那些容易分离的地层的利用变得容易。由于最小蚀刻技术有良好的屏蔽功能，它对地层是有很大益处的。数字地层和模拟地层只在一处相连。如果AD9833 是唯一要求AGND对DGND连接的设备，则两地层应该在AD9833的AGND和DGND管脚处连接。如果AD9833是在多个设备要求AGND对DGND 连接的系统中，数字地层和模拟地层的连接只能在一处，一个靠近AD9833的星形接地点。

应当阻止数字线路从AD9833下面走线，因为这样会让噪声耦合到芯片封装。而模拟地层应该允许从AD9833下面走线，这样可以阻止噪声耦合。AD9833的的电源线路应该尽量和大的线路一样宽，这样可以提供低阻抗线路，减少电源线路的故障。快速转换信号（比如时钟）应该用数字地形式给予保护，以防止它们对电路板其他部分的辐射噪声。应该防止数字信号和模拟信号的交叉。电路板两步的走线应该直角交叉，这样可以减少层间串扰。微波传送技术是迄今为止最好的，但是它却不是常常适合双面板的。在这个技术中，电路板的一面专门用来做地层，另一面做信号层。

好的去耦合是非常重要的。AD9833和电源之间应该并联地接一个0.1uF的陶瓷电容器与10uF的钽电容器。为了让去耦电容达到最佳效果，去耦电容应该尽量接近AD9833，理想状况是在它上面。

比较器的适当操作需要好布局策略。这种策略必须通过适当的PCB布局和以地层来增强隔离效果的手段来使最小化V IN和SIGN BIT OUT管脚之间的寄生电容。比如，在一个四层板中，C IN信号要连接到顶层，而SIGN BIT OUT要连接到底层，所以隔离是由电源和地层提供的。

图七 AD9833初始化及操作流程

图八 初始化

图九 数据写操作

和各种微处理器的连接：

AD9833有一个标准串行接口，可以与一些微处理器直接连接，用外部串行时钟来往自身写数据和控制信息，串行时钟频率最高可达40MHz，在写操作的过程中可能是连续的，也可能一直保持高电平或低电平。如果有数据/控制信息写入AD9833，FSYNC在16位信息写进AD9833的过程中一直保持低电平。FSYNC信号显示16位信息被写入AD9833。

AD9833和ADSP-21xx连接：

图十

图十显示了AD9833和ADSP-21xx的串行连接。ADSP-21xx必须设置工作在SPORT传输交替取景模式。ADSP-21xx通过SPORT控制寄存器编程，设置如下：

内部时钟操作(ISCLK = 1)

低取景激活(INVTFS = 1)

16位字长(SLEN = 15)

内部帧同步信号(ITFS = 1)

为每一个写操作产生一个帧同步信号(TFSR = 1)

SPORT被使能后，往Tx寄存器中写一个字就初始化了传输过程。数据在串行时钟的上升沿到达，在SCLK的下降沿被写进AD9833。

AD9833和68HC11/68L11连接：

图十一

图十一显示了AD9833和68HC11/68L11微处理器的串行连接。通过把SPCR中的MSTR位置1就可以把微处理器设置成控制方。当MOSI输出驱动串行数据SDATA时，SCK上会提供串行时钟。68HC11/68L11微处理器没有专门的帧同步信号管脚，FSYNC是从AD9833的PC7获得的。连接正确工作的设置条件如下：

SCK在写操作过程中保持高电平(CPOL = 0)。

数据在SCK下降沿有效(CPHA = 1)。

在数据往AD9833传输的过程中，FSYNC保持低电平。在传输电路中，来自68HC11/68L11的串行数据以8-bit字节在八个时钟下降沿进行传输。MSB最先被传输。为把数据写入AD9833，8-bit数据传输完毕以后PC7依然要保持低电平，接着开始下一个对AD9833的写操作。只有等到第二个8-bit数据传输完毕后，FSYNC才能重新变成高电平。

AD9833和80C51/80L51连接：

图 十二

图十二显示了AD9833和80C51/80L51微处器的串行连接。80C51/80L51微处理器工作在模式0，80C51/80L51的TxD、RxD分别驱动AD9833的SCLK、SDATA。FSYNC由一位可编程引脚（图中的P3.3）驱动。当数据传输要到AD9833时，P3.3置低电平。80C51/80L51时以8-bit字节形式传输数据，所以每次传输只需要SCLK下降沿。为把数据写入AD9833，第一个8-bit数据传输完毕以后P3.3依然要保持低电平，接着初始化下一个字节的的写操作。第二个写操作结束后，P3.3被置高电平。在两次写操作的过程中，SCLK必须一直保持高电平。80C51/80L51本来是以LSB在前的格式输出串行数据的。但是AD9833首先接受的是MSB（往目标寄存器写时，首先4个MSB是控制信息，接下来4个是地址，8个LSB才是数据）。因此，80C51/80L51的传输例程必须考虑到这点，重新安排位序，让MSB先输出。

AD9833和DSP56002连接：

图十三

上图显示了AD9833和DSP56002的串行连接。DSP56002被设置成正常工作模式下使用内部门控时钟的异步操作（SYN = 0,GCK = 1, SCKD = 1）。帧同步引脚信号由内部产生（SC2=1）,传输宽度为16位(WL1=1，WL0=0)，帧同步信号需要和16位数据适应（FSL=0）。帧同步信号可以在管脚SC2上选择，但是信号在应用到AD9833之前应该被取反。与DSP56000/

DSP56001的连接同与DSP56002的连接类似。

AD9833评测板：

AD9833评测板可以让设计者用最小的代价评测高性能AD9833 DDS调节器。为了验证这个设备可以满足用户波形合成的需求，只需要一个电源，一台IBM兼容PC，一台频谱分析仪和这块评测板。

DDS评测包包含了一块经过经过组装、测试的AD9833印刷电路板。评测板通过PC并口与PC相连，支持软件编程，用户可以很容易地对AD9833编程。评测板的示意图如图14所示。软件运行环境包括Windows? 95, Windows 98, Windows ME, Windows 2000 NT。

图 十四

AD9833评测板的使用

AD9833评测包是一个用来简化AD9833评测过程的测试系统，提供的应用手册中给出了详尽的评测板操作信息。

原型区域：

评测板上留有一块区域可以让用户往评测系统中添加额外电路。比如在最终设计中，用户有可能想要为输出添加一般的模拟滤波器或者缓存和运行放大器。

XO vs 外部时钟

AD9833可以在控制时钟高达25M的情况下工作。评测板上就有一个25M的晶振。但是如果需要，这个晶振可以去掉，而外接CMOS时钟。

电源：

AD9833评测板的电源必须通过引脚从外部接入。电源线应该双绞以减小地线干扰。

AD9833 迷你10引脚外形尺寸：